SLX

为您的多核项目提供最佳编程解决方案

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不管您是软件模型的系统架构师,还是使用内部代码、开源代码、商业源代码或者二进制代码的程序开发员,传统的软件优化方法都已不再适用于多核系统。要完全了解多核系统上的应用程序行为,就需要对软件相互依赖性进行全面而精确的分析。

要达到全面理解系统行为,并且寻求机会提高性能和节省功耗的目标,需要一个工具来深入了解执行期间发生的软件相互依赖性。

SLX正是这样的一种多核开发工具,它可对硬件和软件相互依赖性提供软件执行洞察。 它允许代码的架构和重构,从而在多核系统上实现CPU,DSP,FPGA和其他加速引擎的最有效利用。

SLX

FPGA

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SLX FPGA能够将C/C++代码更轻松、更快速、更高性能地转换为FPGA数据流。SLX FPGA充分考虑了FPGA供应商提供的HLS(高级综合)工具的相关标准,在此基础上成功解决了与HLS设计流程相关的挑战,其中包括非可合成的C / C ++代码、低硬件兼容的C / C ++代码,对应用程序并行性的检测,找寻合适位置插入编译指示,以及如何确定最佳的软硬件分区等。使用SLX FPGA,您可以充分将HLS的优势运用于FPGA设计,从而更快地进入市场。这些优势包括通过更高级别的抽象设计来提高生产力,比传统RTL仿真更快地模拟数量级,以及通过高级优化和设计空间探索实现更高的QoR。

SLX FPGA通过执行静态和动态代码分析,深入洞察用户的C/C++代码,解决了使用HLS设计流程的难题。通过代码分析,SLX FPGA可识别非合成的C/C++代码,检测低硬件兼容数据类型,并在软件内确定可在硬件中实现加速的并行性。SLX FPGA为HLS高阶合成提供引导式和自动代码重构,有助于解决使用HLS设计流程的最大障碍和最耗时部分。最后,SLX FPGA使用检测到的并行性自动生成和插入HLS编译指示,从而优化性能和区域利用率的设计。

产品简介下载 产品演示视频
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对C / C ++代码的HLS可合并性提出明确指示

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对软硬件进行分区探索

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自动插入编译指示(OpenMP,HLS)

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